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A new, small, and optimized for low power processor core named SIRIUS has been developed, simulated, synthesized to a netlist and verified. From this netlist, containing only primitives like gates and flip-flops, a mapping to an ASIC - or FPGA technology can easily be done with existing synthesizer tools, allowing very complex SOC designs with several blocks. Emulation via FPGA can be done on already simple setups and cheap hardware because of the small core size. The performance is estimated 50 MIPS on Cyclone II FPGA and about 100 MIPS on a 0.35 CMOS 5M2P technology with 4197 primitives used for the core, including a 16 x 16 multiplier. An example design of the ASIC for an electronic ePille device currently in development is shown.
Das Institut für Angewandte Forschung (IAF) der Hochschule Offenburg ist seit mehr als 3 Jahren an der Entwicklung einer elektronischen Pille engagiert, die die bisher übliche chemische Freisetzung von Medikamenten im Darm durch eine gesteuerte, über Telemetrie ausgelöste Freisetzung ersetzen soll Damit lassen sich Therapien durchführen und Medikamente verwenden, die in der klassischen Form nicht möglich sind.